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嵌入式OS-Linux

Linux應(yīng)用開發(fā)班
嵌入式Linux系統(tǒng)開發(fā)班

嵌入式Linux驅(qū)動開發(fā)班
Linux網(wǎng)絡(luò)工程及系統(tǒng)管理
QT應(yīng)用開發(fā)培訓(xùn)班
Linux內(nèi)核剖析高級培訓(xùn)班
嵌入式Linux實時系統(tǒng)與內(nèi)核開發(fā)班
RT Linux開發(fā)高級班
嵌入式Linux/MiniGUI高級培訓(xùn)班
Linux高手直通車-LPI全球認(rèn)證課程
嵌入式Linux高級編程及網(wǎng)絡(luò)核心技術(shù)
Linux驅(qū)動、系統(tǒng)、應(yīng)用全能班

嵌入式CPU--ARM

ARM開發(fā)培訓(xùn)班

CortexM3+uC/OS培訓(xùn)班

Cortex-M0開發(fā)培訓(xùn)班

eCos驅(qū)動移植培訓(xùn)

MIPS高級開發(fā)班

BlackFin培訓(xùn)(基于uClinux平臺)

嵌入式OS--WinCE

WinCE應(yīng)用開發(fā)培訓(xùn)班

WinCE系統(tǒng)定制與驅(qū)動班

Windows CE項目案例培訓(xùn)班

單片機(jī)培訓(xùn)

單片機(jī)系統(tǒng)開發(fā)初級和中級班

單片機(jī)系統(tǒng)開發(fā)高級班

單片機(jī)與ZigBee無線網(wǎng)絡(luò)實戰(zhàn)

單片機(jī)電機(jī)控制與變頻/逆變控制技術(shù)

汽車單片機(jī)與車載網(wǎng)絡(luò)技術(shù)培訓(xùn)班

語音技術(shù)及單片機(jī)應(yīng)用開發(fā)

嵌入式硬件設(shè)計

高速嵌入式系統(tǒng)硬件設(shè)計班

Allegro Cadence PCB設(shè)計初級和中級班

Allegro Cadence PCB設(shè)計高級班

Power Pcb(PADS)設(shè)計培訓(xùn)班

Protel培訓(xùn)班

高效開關(guān)電源設(shè)計與提高班

電源設(shè)計高級工程師班

電路設(shè)計培訓(xùn)

EMC設(shè)計高級培訓(xùn)班

PCB Layout培訓(xùn)-線路板設(shè)計全能班

Allegro Cadence PCB Layout高級班

Cadence SI 仿真分析工具專題班

信號完整性專題班

Altium Designer Layout高速硬件設(shè)計

Mentor EE 高速電路板設(shè)計與仿真

Mentor WG 高速電路板設(shè)計與仿真

模擬電路前端設(shè)計培訓(xùn)班

電路設(shè)計全能班

電子電路設(shè)計高級培訓(xùn)班

模擬電路設(shè)計高級工程師班

芯片設(shè)計培訓(xùn)班

Cadence IC 設(shè)計與驗證

集成電路（IC）版圖設(shè)計培訓(xùn)班

RF射頻電路設(shè)計培訓(xùn)班

數(shù)字集成電路前端設(shè)計高級培訓(xùn)班

數(shù)字、模擬電路設(shè)計高級培訓(xùn)班

模擬集成電路設(shè)計高級培訓(xùn)班

SOC設(shè)計培訓(xùn)班

嵌入式OS--VxWorks

VxWorks應(yīng)用開發(fā)培訓(xùn)班

VxWorks BSP開發(fā)高級班

PowerPC嵌入式系統(tǒng)/編譯器優(yōu)化

PowerPC(PPC)系統(tǒng)開發(fā)培訓(xùn)班

飛思卡爾MPC系統(tǒng)開發(fā)培訓(xùn)班

編譯器原理及優(yōu)化技術(shù)專題班


PLC編程/變頻器/數(shù)控/人機(jī)界面

PLC編程系列培訓(xùn)課程表
變頻器系列培訓(xùn)課程表

人機(jī)界面、數(shù)控系列培訓(xùn)課程表

開發(fā)語言/數(shù)據(jù)庫/軟硬件測試

C語言培訓(xùn)班

C++語言培訓(xùn)班

JAVA語言培訓(xùn)班

SQL Server數(shù)據(jù)庫培訓(xùn)

軟件測試培訓(xùn)

硬件測試培訓(xùn)

系統(tǒng)構(gòu)架師培訓(xùn)

Windows驅(qū)動開發(fā)培訓(xùn)班

3G手機(jī)軟件測試、硬件測試

3G軟件測試工程師班

嵌入式測試和3G手機(jī)硬件測試班

芯片設(shè)計/大規(guī)模集成電路VLSI

芯片、集成電路設(shè)計系列一課程表

芯片、集成電路設(shè)計系列二課程表

手機(jī)電路原理、維修與調(diào)試

iPhone手機(jī)與調(diào)試

Android平臺手機(jī)維修

國產(chǎn)/mtk手機(jī)電路原理、維修與調(diào)試

手機(jī)電路原理、維修與調(diào)試全能班

云計算、物聯(lián)網(wǎng)

云計算、云安全培訓(xùn)班

物聯(lián)網(wǎng)產(chǎn)業(yè)、核心技術(shù)培訓(xùn)班

物聯(lián)網(wǎng)高級工程師培訓(xùn)班

高校物聯(lián)網(wǎng)與嵌入式師資培訓(xùn)班

無線傳感網(wǎng)絡(luò)技術(shù)培訓(xùn)

開源操作系統(tǒng)Tiny OS開發(fā)

小型機(jī)系統(tǒng)管理

IBM AIX 6 Basics培訓(xùn)班

IBM AIX 6 System II培訓(xùn)班

Solaris 操作系統(tǒng)網(wǎng)絡(luò)管理

HP-Unix系統(tǒng)及網(wǎng)絡(luò)管理

IBM 大型機(jī)操作系統(tǒng)培訓(xùn)班

SolidEdge ST&ST2 實戰(zhàn)

網(wǎng)絡(luò)安全管理實戰(zhàn)培訓(xùn)

大型機(jī)培訓(xùn)實戰(zhàn)系列課程表

檢測/傳感器/汽車電子及其他

汽車電子

長期班

全國高校3G技術(shù)師資培訓(xùn)班

傳感器技術(shù)原理與應(yīng)用培訓(xùn)班

微弱信號檢測與放大培訓(xùn)班

測量電子電路設(shè)計
(濾波器和模擬OP放大器電路)

高低頻電路設(shè)計與制作培訓(xùn)班

鎖相環(huán)(PLL)電路設(shè)計與應(yīng)用培訓(xùn)班

振蕩電路的設(shè)計與應(yīng)用培訓(xùn)班

變壓器與電感器設(shè)計培訓(xùn)班

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現(xiàn)代化的多媒體教室

FPGA與DSP聯(lián)合應(yīng)用

.班.級.規(guī).模.及.環(huán).境

為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限5人，多余人員安排到下一期進(jìn)行。注意：本課程一旦開課不予退費。

時間地點

上課地點：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學(xué)/六宅臻品【鄭州分部】：鄭州大學(xué)/錦華大廈【石家莊分部】：河北科技大學(xué)/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：云峰大廈
近開課時間(周末班/連續(xù)班/晚班）：FPGA和DSP聯(lián)合班：2014年08月31日

學(xué)時和費用

        ★課時：共6天，總計36學(xué)時

        ◆外地學(xué)員：代理安排食宿（需提前預(yù)定） ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學(xué)員免費推薦工作
        ★實驗設(shè)備請點擊這兒查看★

新優(yōu) 惠措施

◆團(tuán)體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠。注意：在讀學(xué)生憑學(xué)生證，即使一個人也優(yōu)惠500元。

.質(zhì).量.保.障.

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費提供一個月的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機(jī)會。

課程大綱:

FPGA與DSP聯(lián)合應(yīng)用

FPGA與DSP聯(lián)合應(yīng)用
課程簡介：	DSP應(yīng)用是展示FPGA優(yōu)勢的有效場合。通過本次課的學(xué)習(xí)，可以幫助學(xué)員掌握使用FPGA實現(xiàn)DSP的基本理論和實現(xiàn)方法。掌握針對DSP的Verilog編程方法，實現(xiàn)如Cordic算法、FFT IP Core使用等經(jīng)典內(nèi)容。
培訓(xùn)時長：	四天
必備條件：	熟練掌握Verilog HDL
獲得技能：	掌握使用FPGA實現(xiàn)DSP的基本理論和實現(xiàn)方法。
課程大綱：	第一階段
	Verilog for DSP
	第二階段
	Cordic算法實現(xiàn)
	第三階段
	浮點算法的定點處理
	第四階段
	浮點數(shù)與定點數(shù)
	第五階段
	浮點如何轉(zhuǎn)定點
	第六階段
	FPGA實現(xiàn)DSP的優(yōu)勢及應(yīng)用的典型場合
	第七階段
	多速率信號處理(中頻數(shù)字化的理論)
	第八階段
	帶通采樣定理
	第九階段
	內(nèi)插與抽取
	第十階段
	FFT IP Core的使用方法
	第十一階段
	FPGA+DSP架構(gòu)分析

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